在線網(wǎng)校：>>>點(diǎn)擊進(jìn)入<<<
網(wǎng)校以及考試書庫開發(fā)及擁有課件范圍涉及公務(wù)員/財(cái)會類/學(xué)歷類/建筑工 程類
等9大類考試的在線網(wǎng)絡(luò)培訓(xùn)輔導(dǎo)和全新引進(jìn)高清3D電子書考試用書。
| 考查要點(diǎn): 1、掌握數(shù)制、碼制的概念，各種進(jìn)制的相互轉(zhuǎn)換；掌握幾種編碼規(guī)則及其特點(diǎn)。 2、掌握邏輯代數(shù)中的三種基本運(yùn)算、基本公式和基本定理；掌握邏輯函數(shù)及其表示方法，熟練掌握邏輯函數(shù)的公式化簡法和卡諾圖化簡法；熟悉具有無關(guān)項(xiàng)的邏輯函數(shù)及其化簡。 3、掌握正負(fù)邏輯的概念。掌握三極管深度飽和的條件，能計(jì)算三極管深度飽和時(shí)電路的參數(shù)。會利用門電路的帶負(fù)載能力靈活計(jì)算電路參數(shù)。計(jì)算帶負(fù)載能力，扇出系數(shù)。掌握三態(tài)門、OC門、OD門和傳輸門的特點(diǎn)和用途，能夠針對于實(shí)際問題，選用一種門電路。能夠?qū)懗鲆粋€(gè)電路圖實(shí)現(xiàn)的邏輯功能，畫出其邏輯符號，寫出邏輯表達(dá)式。能夠利用門電路的帶負(fù)載能力靈活計(jì)算電路參數(shù)。 4、掌握組合邏輯電路的分析方法和設(shè)計(jì)方法；掌握常用組合邏輯電路的邏輯功能和使用方法。會讀集成器件的功能表，并利用功能表分析、設(shè)計(jì)組合邏輯電路。掌握邏輯門電路多余的輸入管腳的處理方法。了解組合邏輯電路中的競爭—冒險(xiǎn)現(xiàn)象。 5、熟悉各類觸發(fā)器的電路結(jié)構(gòu)與動作特點(diǎn)；掌握觸發(fā)器的邏輯功能及其描述方法和不同類型觸發(fā)器之間的相互轉(zhuǎn)換。 6、掌握時(shí)序邏輯電路的分析方法和設(shè)計(jì)方法。會讀集成器件的功能表，并能夠用集成時(shí)序邏輯電路芯片的功能表分析、設(shè)計(jì)時(shí)序邏輯電路。 7、掌握施密特觸發(fā)器、單穩(wěn)態(tài)觸發(fā)器、多諧振蕩器、555定時(shí)器的工作原理及其應(yīng)用。能夠計(jì)算電路參數(shù)。 8、了解A/D、D/A轉(zhuǎn)換器的類型，掌握A/D、D/A轉(zhuǎn)換器的工作原理、性能指標(biāo)和使用方法。能夠利用D/A變換器實(shí)現(xiàn)D/A轉(zhuǎn)換、信號產(chǎn)生、數(shù)控衰減電路。 9、了解半導(dǎo)體存儲器的類型及其特點(diǎn)，掌握存儲容量的表示方法，了解存儲器容量的擴(kuò)展方法，能夠進(jìn)行字?jǐn)U展和位擴(kuò)展。 10、可編程邏輯器件的分類和邏輯符號的表示方法。了解CPLD和FPGA差別。能夠分析設(shè)計(jì)“與－或”邏輯陣列的邏輯和用與或邏輯陣列實(shí)現(xiàn)邏輯函數(shù)。 |
| 考試總分：200分（復(fù)試） 考試時(shí)間：2小時(shí) 考試方式：筆試考試題型： 概念題（80--90分）（包括簡答題和選擇題） 基礎(chǔ)題、分析、設(shè)計(jì)和計(jì)算題（90--100分）綜合題（分析、設(shè)計(jì)）（20分） |
更多學(xué)歷考試信息請查看學(xué)歷考試網(wǎng)
公眾號
事業(yè)單位
當(dāng)前位置：
公考類
招聘類
各類考試